95.图a）所示电路中，复位信号，信号A及时钟脉冲信号cp如图b）所示，经分析可知，在笫一个和第二个时钟脉冲的下降沿时刻，输出Q分别等于（）。附：触发器的逻辑状态表为：
A、0 0
B、0 1
C、1 0
D、1 1
B、0 1
C、1 0
D、1 1
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其他
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此电路是组合逻辑电路（异或门）与时序逻辑电路（D触发器）的组合应用，电路的初始状态由复位信号
确定，输出状态在时钟脉冲信号cp的上升沿触发。
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