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图a)所示电路中,位信号信号A及时钟脉冲信号cp如图b))所示,经分析可知,在第一个和第二个时钟脉冲的下降沿时刻,输出Q先后等于:附:触发器的逻辑状态表为:


A、0,0
B、0,1
C、1,0
D、1,1

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图示为D触发器,触发时刻为cp波形的上升沿,输入信号D=A,输出波形为Q所示,对应于第一和第二个脉冲的下降沿,Q为高电平“1”。 

图a)所示电路中,位信号信号A及时钟脉冲信号cp如图b))所...

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