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由两个主从型JK触发器组成的逻辑电路如图(a) 所示,设 的初始态是0、0, 已知输入信号A和脉冲信号cp的波形,如图(b)所示,当第二个cp脉冲作用后,将变为( )。


A、1、1
B、1、0
C、0、1
D、保持0、0不变

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该触发器为下降沿触发方式,即当时钟信号由高电平下降为低电平时刻输出端的状态可能发生改变。根据题90解表1和解表2,由两个主从型JK触发器组成的逻辑电路如图(a) 所示,设 的... 。所以,当第二个qp脉冲作用后,由两个主从型JK触发器组成的逻辑电路如图(a) 所示,设 的...将变为0、1。

由两个主从型JK触发器组成的逻辑电路如图(a) 所示,设 的...

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