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图(a) 所示电路中,时钟脉冲、复位信号及数模信号如图(b) 所示,经分析可知,在第一个和第二个时钟脉冲的下降沿过后,输出Q先后等于()。 附:触发器的逻辑状态表为:


A、00
B、01
C、10
D、11

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CP下降沿起作用,存在复位端,J=AQ; 通过复位端复位,Q初始值为0,在第一个时钟脉冲下降沿处A为高电平,取值为1,这时J取值0,K取值0, JK触发器发挥保持功能,Q输出为0;当第二个下降沿来临时,A取值为0,通过逻辑关系得知,J依然为0,同理可推得,Q输出为0。 

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